Ablauf des Blockseminars

Mittwoch, 3.2.2016
8:50 Treffpunkt München Ostbahnhof, Gleis 8 (Treppenaufgang Richtung Süden)
9:04 Abfahrt M79011 nach Prien (Bayernticket wird von uns besorgt) Ankunft Prien: 9:51, Fussweg zum Hafen (mit Kaffeepause)
11:00 Abfahrt Boot nach Frauenchiemsee, Ankunft 11:30
11:30 Bezug der Zimmer
12:00 Mittagessen
13:30 Start Seminar
13:30 Fabio Gratl - Many-core-Architekturen (Xeon Phi)
14:15 Johannses Klicpera - Verbindung von CPUs und GPUs: AMD APUs
15:00 Kaffeepause
15:30 Paul Nieleck - Use of mobile SoCs in HPC
16:15 Markus Loipfinger - Non-Volatile Memory: Typen und Nutzung für HPC
17:00 Andreas Seibold - Aktuelle Speichertechnologien: HBM/HMC
18:00 Abendessen

Donnerstag, 4.2.2016
8:00 Frühstück
9:00 Start Seminar (Zimmer vorher räumen)
9:00 Stefan Effenberger - HPC interconnection topologies - a state-of-the-art analysis
9:45 Matthias Hoeschel - Anton 2: ein Hochleistungsrechner für Simulationen in der Molekulardynamik
10:30 Daniyal Kazempour - Got Brain(s)? A Review and Critical Assessment on Neuromorphic Computing
11:15 Jon-Magnus Maier - Adiabatische Quantencomputer
12:00 Mittagessen
13:30 Feedback-Runde / Evaluierung
15:00 Rückfahrt Boot (Ankunft Prien Hafen 15:30)
16:06 Rückfahrt von Prien/Bahnhof M79034
16:56 Ankunft München Ost

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